Registers with AXI4-Lite interface (VHDL.zip)

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AXI4-Liteインタフェース接続のレジスタサンプルです。
HDL内部にはアドレス0x00~0x3Cまでの32ビットレジスタを設けています。
レジスタに設定された値を外部出力する際のサンプルとして、0x00アドレスの0ビット目及び0x04アドレスの32ビット信号を設けています

言語はVHDLを使用しており、VHDL97以降の環境に適合します。
字下げはハードタブを使用しています。タブの設定はタブストップ4でご覧下さい。

ドキュメントはこちら->http://www.gopher-tec.jp/web_store/DOC/RegsWithAxi4-LiteInterface.pdf

¥ 30,000

※こちらの価格には消費税が含まれています。

※こちらの商品はダウンロード販売です。(381026 バイト)

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